Madhukar Pappireddy
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/*
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* Copyright (c) 2016 - 2021, Broadcom |
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* SPDX-License-Identifier: BSD-3-Clause |
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*/ |
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#include <string.h> |
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#include <platform_def.h> |
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#include <common/debug.h> |
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#include <drivers/delay_timer.h> |
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#include <lib/mmio.h> |
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#include <mdio.h> |
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static int mdio_op_status(uint32_t result) |
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{ |
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uint32_t timeout = 1000000U; /* loop for 1s */ |
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uint32_t val; |
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do { |
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val = mmio_read_32(CMIC_MIIM_STAT); |
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if ((val & MDIO_STAT_DONE) == result) { |
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return 0; |
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} |
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udelay(1U); |
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} while (timeout-- != 0U); |
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return -1; |
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} |
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static int mdio_op(uint16_t busid, uint16_t phyid, uint32_t reg, |
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uint16_t val, uint8_t op) |
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{ |
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uint32_t param; |
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int ret; |
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mmio_write_32(CMIC_MIIM_CTRL, 0U); |
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ret = mdio_op_status(0U); |
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if (ret != 0) { |
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goto err; |
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} |
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param = 0U; |
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param |= 1U << MDIO_PARAM_INTERNAL_SEL; |
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param |= (busid & MDIO_PARAM_BUSID_MASK) << MDIO_PARAM_BUSID; |
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param |= (phyid & MDIO_PARAM_PHYID_MASK) << MDIO_PARAM_PHYID; |
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param |= (val & MDIO_PARAM_DATA_MASK) << MDIO_PARAM_DATA; |
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mmio_write_32(CMIC_MIIM_PARAM, param); |
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mmio_write_32(CMIC_MIIM_ADDRESS, reg); |
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mmio_write_32(CMIC_MIIM_CTRL, op); |
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ret = mdio_op_status(1U); |
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if (ret != 0) { |
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goto err; |
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} |
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if (op == MDIO_CTRL_READ_OP) { |
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ret = mmio_read_32(CMIC_MIIM_READ_DATA) & MDIO_READ_DATA_MASK; |
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} |
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err: |
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return ret; |
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} |
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int mdio_write(uint16_t busid, uint16_t phyid, uint32_t reg, uint16_t val) |
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{ |
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int ret; |
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ret = mdio_op(busid, phyid, reg, val, MDIO_CTRL_WRITE_OP); |
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if (ret == -1) { |
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INFO("MDIO write fail\n"); |
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} |
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return ret; |
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} |
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int mdio_read(uint16_t busid, uint16_t phyid, uint32_t reg) |
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{ |
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int ret; |
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ret = mdio_op(busid, phyid, reg, 0U, MDIO_CTRL_READ_OP); |
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if (ret == -1) { |
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INFO("MDIO read fail\n"); |
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} |
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return ret; |
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} |
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/*
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* Copyright (c) 2016 - 2021, Broadcom |
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* |
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* SPDX-License-Identifier: BSD-3-Clause |
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*/ |
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#ifndef MDIO_H |
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#define MDIO_H |
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#define CMIC_MIIM_PARAM (PLAT_CMIC_MIIM_BASE + 0x23cU) |
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#define MDIO_PARAM_MIIM_CYCLE 29U |
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#define MDIO_PARAM_INTERNAL_SEL 25U |
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#define MDIO_PARAM_BUSID 22U |
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#define MDIO_PARAM_BUSID_MASK 0x7U |
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#define MDIO_PARAM_C45_SEL 21U |
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#define MDIO_PARAM_PHYID 16U |
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#define MDIO_PARAM_PHYID_MASK 0x1FU |
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#define MDIO_PARAM_DATA 0U |
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#define MDIO_PARAM_DATA_MASK 0xFFFFU |
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#define CMIC_MIIM_READ_DATA (PLAT_CMIC_MIIM_BASE + 0x240U) |
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#define MDIO_READ_DATA_MASK 0xffffU |
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#define CMIC_MIIM_ADDRESS (PLAT_CMIC_MIIM_BASE + 0x244U) |
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#define CMIC_MIIM_CTRL (PLAT_CMIC_MIIM_BASE + 0x248U) |
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#define MDIO_CTRL_WRITE_OP 0x1U |
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#define MDIO_CTRL_READ_OP 0x2U |
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#define CMIC_MIIM_STAT (PLAT_CMIC_MIIM_BASE + 0x24cU) |
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#define MDIO_STAT_DONE 1U |
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int mdio_write(uint16_t busid, uint16_t phyid, uint32_t reg, uint16_t val); |
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int mdio_read(uint16_t busid, uint16_t phyid, uint32_t reg); |
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#endif /* MDIO_H */ |
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